硬件工程师笔试面试题集(含答案,很全)
26页1、硬件工程师面试题集硬件工程师面试题集 (DSPDSP,嵌入式系统,嵌入式系统,电子线路,电子线路,通讯,微电子,半导体)通讯,微电子,半导体) -Real_YamedeReal_Yamede 1、下面是一些基本的数字电路知识问题,请简要回答之。 (1) 什么是什么是 Setup 和和 Hold 时间?时间? 答: Setup/Hold Time 用于测试芯片对输入信号和时钟信号之间的时间要求。 建立时间(Setup Time)是指触发器的时钟信号上升沿到来以前,数据能够保持稳 定不变的时间。输入数据信 号应提前时钟上升沿(如上升沿有效)T 时间到达芯片,这个 T 就是建立时间通常所说的 SetupTime。如不满足 Setup Time,这个数据就不能被这一时钟打入触发器,只有在下一个 时钟上升沿到来时,数据才能被打入 触发器。保持时间(Hold Time)是指触发器的时钟信号 上升沿到来以后,数据保持稳定不变的时间。如果 Hold Time 不够,数据同样不能被打入 触发器。 (2) 什么是竞争与冒险现象?怎样判断?如何消除?什么是竞争与冒险现象?怎样判断?如何消除? 答:在组合逻辑
2、电路中,由于门电路的输入信号经过的通路不尽相同,所产生的延时也就会 不同,从而导致到达该门的时间不一致,我们把这种现象叫做竞争。由于竞争而在电路输出 端可能产生尖峰脉冲或毛刺的现象叫冒险。 如果布尔式中有相反的信号则可能产生竞争和冒 险现象。解决方法:一是添加布尔式的消 去项,二是在芯片外部加电容。 (3) 请画出用请画出用 D 触发器实现触发器实现 2 倍分频的逻辑电路倍分频的逻辑电路 答:把 D 触发器的输出端加非门接到 D 端即可,如下图所示: (4) 什么是什么是“线与线与“逻辑,要实现它,在硬件特性上有什么具体要求?逻辑,要实现它,在硬件特性上有什么具体要求? 答:线与逻辑是两个或多个输出信号相连可以实现与的功能。在硬件上,要用 OC 门来实 现(漏极或者集电极开路),为了防止因灌电流过大而烧坏 OC 门,应在 OC 门输出端接一上 拉电阻(线或则是下拉电阻)。 (5) 什么是同步逻辑和异步逻辑?同步电路与异步电路有何区别?什么是同步逻辑和异步逻辑?同步电路与异步电路有何区别? 答:同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系. 电路设计可分类为
3、同步电路设计和异步电路设计。 同步电路利用时钟脉冲使其子系统同步运 作,而异步电路不使用时钟脉冲做同步,其子系统是使用特殊的 “开始”和“完成”信号 使之同步。异步电路具有下列优点:无时钟歪斜问题、 低电源消耗、平均效能而非最差效 能、模块性、可组合和可复用性。 (7) 你知道那些常用逻辑电你知道那些常用逻辑电平?平?TTL 与与 COMS 电平可以直接互连吗?电平可以直接互连吗? 答:常用的电平标准,低速的有 RS232、RS485、RS422、TTL、CMOS、LVTTL、LVCMOS、 ECL、ECL、LVPECL 等,高速的有 LVDS、GTL、PGTL、 CML、HSTL、SSTL 等。 一般说来,CMOS 电平比 TTL 电平有着更高的噪声容限。如果不考虑速度 和性能,一般 TTL 与 CMOS 器件可以互换。但是需要注意有时候负载效应可能 引起电路工作不正常, 因为有些 TTL 电路需要下一级的输入阻抗作为负载才能 正常工作。 (6) 请画出微机接口电路中,典型的输入设备与微机接口逻辑示意图请画出微机接口电路中,典型的输入设备与微机接口逻辑示意图(数据接口、控制接口、数据
4、接口、控制接口、 锁存器锁存器/缓冲器缓冲器) 典型输入设备与微机接口的逻辑示意图如下: 2、你所知道的可编程逻辑器件有哪些?、你所知道的可编程逻辑器件有哪些? 答:ROM(只读存储器)、PLA(可编程逻辑阵列)、FPLA(现场可编程逻辑阵列)、PAL(可编程 阵列逻辑)GAL(通用阵列逻辑),EPLD(可擦除的可编程逻辑器件)、 FPGA(现场可编程门阵 列)、CPLD(复杂可编程逻辑器件)等 ,其中 ROM、FPLA、 PAL、GAL、EPLD 是出现较 早的可编程逻辑器件,而 FPGA 和 CPLD 是当今最 流行的两类可编程逻辑器件。FPGA 是基于查找表结构的,而 CPLD 是基于乘积 项结构的。 3、用、用 VHDL 或或 VERILOG、ABLE 描述描述 8 位位 D 触发器逻辑触发器逻辑 4、请简述用、请简述用 EDA 软件软件(如如 PROTEL)进行设计进行设计(包括原理图和包括原理图和 PCB 图图)到调试出样机的整到调试出样机的整 个过程,在各环节应注意哪些问题?个过程,在各环节应注意哪些问题? 答:完成一个电子电路设计方案的整个过程大致可分:(1)原理图设计
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