四川大学数字逻辑实验报告3
4页1、四川大学计算机学院数字逻辑实验实 验 报 告学号:2019141460083 姓名:张昊钰 专业:计算机科学与技术 班级:08 第 11 周 实验项目利用逻辑门构成半加器和全加器,并设计一个2位并行加法器实验时间2019.11.12实验目的 使用逻辑门实现一个半加器级联一个全加器构成两位并行加法器,完成设计,将设计下载到实验板进行验证。实验环境 Win7,Vivado14.2实验内容及步骤(含电路原理图/Verilog程序、管脚分配、仿真结果等;扩展内容也列入本栏) 1)分析输入、输出根据方程和 IP 核库判断需要使用的门电路以及个数(异或门、与门、或门)。 2)创建新的工程,加载 IP 核。 3)在 Project Navigator 下的 IP Integrator 下,点击 Create Block Design,创建新的 Block Design,根据上面的分析添加基本门电路、输入输出端口并连线(注意未使用的输入管脚不能为空)。4)完成原理图设计后,生成顶层文件(Generate Output Product和 HDL 代码文件(Create HDL Wrapper)。 5)配
2、置管脚约束(I/O PLANNING),为4个输入指定相应的拨码开关,为 3 个输出指定相应的 led 灯显示。 要求:在实验报告中参考表列出两个2位二进制数3种不同取值对应的LED灯显示。LED灯的显示分别为:2个亮、2个亮、1个亮原理图:(接上)实验内容及步骤(含电路原理图/Verilog程序、管脚分配、仿真结果等;扩展内容也列入本栏)仿真图:A0=1,A1=0,B0=0,B1=0,1个LED灯亮,板级验证成功。实验结果分析板级验证成功,实现了2位并行加法器的功能。 实验方案的缺陷及改进意见 缺陷:在配置管脚约束文件时,没有为4个输入指定位置合理的拨码开关,导致在板级验证时,不能直接辨别A0、A1、B0、B1,对板级验证的效率和准确性造成了不良影响。 改进意见:要在配置管脚约束文件前,参照拨码开关的位置,合理安排输入指定位置,以便于更高效准确的进行板级验证。心得体会、问题讨论心得体会:配置管脚约束文件时要充分考虑拨码开关的位置是否合理。问题讨论:讨论了由LED灯的显示进行板级验证的可靠性。指导老师评 议 成绩评定: 指导教师签名:实验报告说明 数字逻辑课程组实验名称 列入实验指导书相应的实验题目。实验目的 目的要明确,要抓住重点,可以从理论和实践两个方面考虑。可参考实验指导书的内容。在理论上,验证所学章节相关的真值表、逻辑表达式或逻辑图的实际应用,以使实验者获得深刻和系统的理解,在实践上,掌握使用软件平台及设计的技能技巧。一般需说明是验证型实验还是设计型实验,是创新型实验还是综合型实验。实验环境 实验用的软硬件环境(配置)。实验内容(含电路原理图/Verilog程序、管脚分配、仿真结果等;扩展内容也列入本栏) 这是实验报告极其重要的内容。这部分要写明经过哪几个步骤。可画出流程图,再配以相应的文字说明,这样既可以节省许多文字说明,又能使实验报告简明扼要,清楚明白。实验结果分析 数字逻辑的设计与实验结果的显示是否吻合,如出现异常,如何修正并得到正确的结果。实验方案的缺陷及改进意见 在实验过程中发现的问题,个人对问题的改进意见。心得体会、问题讨论 对本次实验的体会、思考和建议。
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