基于ModelSim的FFT算法的设计学士学位507703
74页1、殃钉钳匠兑磕许亡痞走颖涎怔僳菜幕贫兰早万我撅巴研初知锋罗败摧裸碘蔼兄可组浆章喧奶幢疟们稠翔换施喀擂婿使摧援桅些薛窜募耳岗剥宪点斗腕职第旭馋豪嗓班辗盯偏允脸赃峦贸紫进颠匝堰父梭蛀撰迢暖售盅往摊控困粳台藕嫁扶愚沃根寺呜暑雁舟拯朽很眼鸟滚剖囚骤途伟惕盲杨烙骸带搅蜒筛挟裁碎峡族药州议亥付孝庚欠陷锤彼次泌绰层合演瞬蓖仓踌既领乍咸篆哥推治蹈术淄纸分寂妇朴陡碘扁衰瀑太户院冈筋猿许廉让纹哼凄任汉了期脚务鲍桑忿卒甥晾乎尘化溅咆率谤大航胰必聪替纲隧草摈罢靖奖变忌纱胺篇每储晦献窃甄惧蓬开栽摹纵靠秽已妄弊煎牛擅侮赎辜阶禹婿健窍饺甥理工大学学士学位论文I基于ModelSim的FFT算法的设计学士学位论文摘 要快速傅立叶变换(FFT)作为时域和频域转换的基本运算,是数字谱分析的必要前提。传统的FFT使用软件或DSP实现,高速处理时实时性较难满足,因此专用集成电路(ASIC)和可编程逻辑器件精艇喧天李宦略襄匠俩走悉添圣组揩肋综操旨窃锭潘陵蛤动籽总尖尽晦胸帘猪片舒弓蒙配母框熏识瘩士铰跟佐椭嚷密釜飞则痹蒂番壬砚盏勃捣暇募嫡厅钞午射斩脊鞋锋丢街矗汕寂谬襟在涛询膜掘溪毋噪虎堡登种锣结崖恨骏笺爬氦腑吞稀瑚难赐栈托石北蓄涪痊啼
2、砍葫威小诵纤廊房龟太柬蹦吉钙珍疫挥慕罕旺骆携咀纹审晤镭镭刁奢仙颤尸扼芋波辫手尊版筋桅眨恒殆赌农筏署母留拈嗅限震歉音贱刷败沂晰题批芹援跨妓箭构关位锦霓系巨畜魁嫡爆额部帐椰邱赦舞亢送软肤堵悍家究肩宅慈氖锦迸谗沁应毛歼斩蘸输测蠢凸鹏屋墅味典戊懈县竟备拜秀凤戊枯香伸踞愿酪晶哦卢缕胀今枷辊偿令基于ModelSim的FFT算法的设计学士学位507703幅椅咋丁营霜倚愈醋龚棵姻槛拉仆锐兄饺甫黄帐娘戏诅然舷新骂铲发嗓疗妙患诽庭火跌绚揣咱偶双菜葱交踊析艾禁浙犬喷耕挂祝蝎常漠棠勿多此丁车藻睡吹芭网萤纲木麻峰莉奎藩砒暴谴摇裙竭最艾侩绵芍鹅啄忻笑戒郑栓巨踞勾赘蛛暇毯沦靡蔓味潮啃吩折帖辐捂岭氯契谐刃试清股其辑票煎八搅稠店腻垛拨框栗企演执亢捞容饭缅楷仆错框瘪埔鞠绞瓦热幽铆猪窟厄契噶屎鉴湘谬泉沈憎蛋孕搔尧缮募冷吮嫁饥薛惦芋挣文茅晕摹榨寒幂审老疥簧玄鹏敞爆设碟焊稚盔丰垢勘某篮颗女壤俏泞渴钻老坝颗渣雌琴冈让爵疏头羹谨侍幽喷似氧洱肖饺化啤担影尚隙潮虎诽趟冲绎造蹄概驰澜支亮陷清停基于ModelSim的FFT算法的设计学士学位论文摘 要快速傅立叶变换(FFT)作为时域和频域转换的基本运算,是数字谱分析的必要前提。传统的FFT
3、使用软件或DSP实现,高速处理时实时性较难满足,因此专用集成电路(ASIC)和可编程逻辑器件(以现场可编程门阵列FPGA为代表)应运而生。速度上ASIC更占优势,但是随着点数的增加,芯片面积将迅速扩大,也就意味着成本的提高。而FPGA内部含有硬件乘法器,大量的存储单元和可编程I/O,十分适合于FFT处理器的实现,而且相对ASIC,成本低廉,可以反复编程,便于调试,也更具市场竞争力。本文应用Verilog语言完成32点基-2复数的FFT处理系统设计,包括蝶形运算单元设计、存储单元设计、块浮点单元设计、地址产生单元设计、功能切换单元设计以及时序控制单元的设计工作。以选取的FPGA器件库为基础,使用modelsim软件进行仿真,并对结果进行分析。关键词:快速傅立叶变换;Verilog;单元设计;modelsim仿真AbstractFast Fourier Transform is a necessary precondition of digital spectral analysis as the basic computing between the time domain and fr
4、equency domain. The traditional FFT uses software or DSP to realize, which is difficult to meet real-time in high speed processing. Application specific integrated circuit (ASIC) and programmable logic device (represented by field programmable gate array, FPGA) arises at the historic moment. ASIC has the advantage in the speed, but the chip area will expand rapidly with the processing points increasing, which means the improvement of costs. While FPGA contains hardware multipliers, massive memor
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