常用集成时序逻辑器件及应用
121页1、第 7章 常用集成时序逻辑器件及应用 第 7章 常用集成时序逻辑器件及应用 成计数器 成寄存器和移位寄存器 列信号发生器 第 7章 常用集成时序逻辑器件及应用 成 计 数 器 集成计数器具有功能较完善 、 通用性强 、 功耗低 、工作速率高且可以自扩展等许多优点 , 因而得到广泛应用 。 目前由 表 7出了几种常用 第 7章 常用集成时序逻辑器件及应用 表 7用 第 7章 常用集成时序逻辑器件及应用 用集成计数器功能分析 1. 异步集成计数器 7474五 十进制异步计数器 , 其内部逻辑电路及传统逻辑符号分别如图 7-1(a)、 (b)所示 。 它包含两个独立的下降沿触发的计数器 , 即模 2(二进制 )和模 5(五进制 )计数器; 异步清 0端 端 图 7-1(c)为 74 采用这种结构可以增加使用的灵活性 。 7474 第 7章 常用集成时序逻辑器件及应用 图 774(a) 逻辑图; (b) 传统逻辑符号; (c) 结构框图 C 11 C 11 C 11 K 1 C 11 K 1 R&0192a )( b )74 0M =2 M =5c )章 常用集成时序逻辑器件及应用 74功能表
2、如表 7示 。 从表中看出 , 当, 时 , 无论时钟如何 , 输出全部清 0;而当时 , 无论时钟和清 0信号 输出就置 9。这说明清 0、 置 9都是异步操作 , 而且置 9是优先的 , 所以称端 , 端 。 表 774 第 7章 常用集成时序逻辑器件及应用 当满足 、 时电路才能执行计数操作 , 根据 当计数脉冲从 分频信号 , 即实现二进制计数 。 当 计数脉冲从 实现十进制计数有两种接法 。图 7-2(a)是 8421 先模 2计数 , 后模 5计数 , 由 C、 出 8421 最高位 图 7-2(b)是 5421 先模 5计数 , 后模 2计数 , 由 421 最高位 进位输出 , 波形对称 。 两种接法的状态转换表 (也称态序表 )见表 7 第 7章 常用集成时序逻辑器件及应用 表 7种接法的态序表 第 7章 常用集成时序逻辑器件及应用 图 74(a) 8421 (b) 5421 L S 9 0a ) ( b ) L S 9 0章 常用集成时序逻辑器件及应用 2. 同步集成计数器 74161 74161是模 24(四位二进制 )同步计数器 , 具有计数 、 保持 、 预置
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