西南交通大学_通信工程实验报告
36页1、通信工程实验报告通信工程实验报告班级:班级:_通信通信 1 1 班班_学号:学号: _ 姓名:姓名: 华亿超市华亿超市 实验一实验一 FPGAFPGA 实验实验 BDPSKBDPSK 调制解调器设计调制解调器设计一、实验目的一、实验目的 掌握 BDPSK 的调制和解调原理。 掌握倍频和分频的概念以及原理。 用 VerilogHDL 硬件描述语言建模时序逻辑电路,实现 BDPSK 基带调制解调 系统。2 2、实验报告要求实验报告要求 调制器和解调器的外引脚图和内部结构图。(Microsoft Visio 中截图) 调制器模块和解调器模块的 VerilogHDL 代码及注释。 功能仿真和时序仿真结果的波形。(ModelSim 中截图) (选做)开发板验证后的波形。(示波器上拍照)三、三、 实验结果实验结果1、 BDPSKBDPSK 调制系统的结构图。调制系统的结构图。2、 BDPSKBDPSK 调制器模块的调制器模块的 VerilogHDLVerilogHDL 代码及注释。代码及注释。 分频器:分频器: module fre_div(clk,cp0);/分频器 input clk; out
2、put reg cp0; parameter N=32; integer i=0; initial begincp00.5; % 等概率产生 0 和 1s = 2*ip-1; % BPSK 调制 0 - -1; 1 - 0sMod = kron(s,ones(nRx,1); % sMod = reshape(sMod,nRx,nTx,N/nTx); % 将矩阵转换为 nRx,nTx,N/nTx 形式 h = 1/sqrt(2)*randn(nRx,nTx,N/nTx) + j*randn(nRx,nTx,N/nTx); % 瑞利衰落信道n = 1/sqrt(2)*randn(nRx,N/nTx) + j*randn(nRx,N/nTx); % 0 均值 高斯白噪声% 加入噪声后在信道中传输a = h.*sMod; %将两个矩阵的第三维分别相乘b = sum(h.*sMod,2);%将第三维加为一列c = squeeze(sum(h.*sMod,2);%变换为 2x10 矩阵d = 10(-Eb_N0_dB(ii)/20)*n;%噪声为 2x10 矩阵y = squeeze(sum(h.
3、*sMod,2) + 10(-Eb_N0_dB(ii)/20)*n;% 最大似然接收% -% 当 s1 s2 = +1,+1 sHat1 = 1 1;sHat1 = repmat(sHat1,1 ,N/2);sHat1Mod = kron(sHat1,ones(nRx,1);sHat1Mod = reshape(sHat1Mod,nRx,nTx,N/nTx);%发送矩阵zHat1 = squeeze(sum(h.*sHat1Mod,2) ; %接收矩阵%e = abs(y - zHat1); %取理论接收与实际接收的绝对值J11 = sum(abs(y - zHat1),1);%将两行加为一行 % % % 当 s1 s2 = +1,-1 sHat2 = 1 -1;sHat2 = repmat(sHat2,1 ,N/2);sHat2Mod = kron(sHat2,ones(nRx,1);sHat2Mod = reshape(sHat2Mod,nRx,nTx,N/nTx);zHat2 = squeeze(sum(h.*sHat2Mod,2) ;J10 = sum(abs(y - zHat
4、2),1); % % % 当 s1 s2 = -1,+1 sHat3 = -1 1;sHat3 = repmat(sHat3,1 ,N/2);sHat3Mod = kron(sHat3,ones(nRx,1);sHat3Mod = reshape(sHat3Mod,nRx,nTx,N/nTx);zHat3 = squeeze(sum(h.*sHat3Mod,2) ;J01 = sum(abs(y - zHat3),1);% % 当 s1 s2 = -1,-1 sHat4 = -1 -1;sHat4 = repmat(sHat4,1 ,N/2);sHat4Mod = kron(sHat4,ones(nRx,1);sHat4Mod = reshape(sHat4Mod,nRx,nTx,N/nTx);zHat4 = squeeze(sum(h.*sHat4Mod,2) ;J00 = sum(abs(y - zHat4),1); % % % 从四组数值中找出最小值 jj,所在位置 ddrVec = J11;J10;J01;J00;jj dd = min(rVec,1); % % % mappi
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