4乘以4键盘扫描电路设计
11页1、4*4 键盘扫描电路设计第 1 页 共 12 页南京师范大学泰州学院信息工程学院电子信息工程专业FPGA 实训报告课程名称: 4*4 键盘扫描电路设计 班 级: 09(3)班 学 号: 09090315 姓 名: 周蓓蓓 指导老师: 周爱军、黄金凤 2012 年 6 月 21 日4*4 键盘扫描电路设计第 2 页 共 12 页目录、 前言 2、 4*4 键盘扫描电路设计要求 3、 4*4 键盘扫描电路设计原理图 3、 实验内容及步骤 4、 部分程序说明 4、 引脚分配 8、 波形仿真 7、 部分效果图 8、 实训总结 8、 参考文献 11一、前言电子设计自动化(Electronics Design AutomationEDA)技术是现代电子工程领域的一门新技术。它提供了基于计算机和信息技术的电路系统设计方法。EDA 技术就是依赖功能强大的计算机,对用电路描述语言描述的设计文件,自动地完成编译、化简、分割、综合、布线、优化、仿真等,直至实现既定的电子电路系统的功能。EDA 技术打破了软件设计和硬件设计间的壁垒,是一门综合性学科,一种新的技能技术。它将设计效率和产品性能合二为一,代表了电子
2、设计技术和电子应用技术的发展方向。VHDL 的全名是 Very High Speed Integrated Circuit Hardware Description Language,于 83 年由美国国防部发起创建,由 IEEE(The Institute of Electrical and Electronics Engineers 电气与电子工程师学会)进一步发展,在 87 年作为“IEEE 标准1076”发布,93 年被升级为“IEEE1164” 。硬件描述语言是 EDA 技术的重要组成部分,VHDL 作为电子设计的主流硬件描述语言,被多个 EDA 公司所引用。 VHDL 语言具有很强的电路描述和建模能力,能从多个层次对数字系统进行建模和描述,具有良好的移植性和适应性,从而大大简化了硬件设计任务,提高了电子系统设计的效率4*4 键盘扫描电路设计第 3 页 共 12 页和可靠性。用 VHDL 进行电子系统设计的一个很大的优点是设计者可以专心致力于其功能的实现,而不需要对不影响功能的与工艺有关的因素花费过多的时间和精力。此次课程设计我们组的项目是“出租车计价器” 。我们小组通过老师
3、一个星期的知识讲解并自学了FPGA 设计基础 ,应用 Quartus 软件进行了设计和编辑。二、 4*4 键盘扫描电路设计要求用 Verilog hdl 语言设计一个 4*4 键盘扫描控制器。当用户按某一个键时,获取相应的键值,然后显示出来。电路符号:其中:CLK_1K 对应键盘扫描时钟, COL3.0为列线扫描输入,ROWSCAN3.0 为行线扫描输出,BUTCODE7.0为键值输出,送给数码管显示。编写以上的程序模块,用仿真器检测模块设计得正确与否,并给出仿真波形。配置下载后观察所设计电路的功能.三、4*4 键盘扫描电路设计原理图行信号接到高电平,当没有键按时,行线与列线是断开的,且行线都是高电平(1111) ,行信号作为 FPGA 的输入端、列信号作为 FPGA 的输出端。可以设置列线初始状态为低电平(0000) 。信号为从上到下的顺序,当有键按下时,假如是 K1 按下,行信号与列信号接通,这时相应的行线(KEY0 )变为低电平(01111) ,可以肯定第一行( K1,5,9,13)有键按下。下面就要运用扫描的原理了:1、因为只知道第一行有键按下,不知道是那个,可以设置列信号为
4、0111, 这时行信号变为(1111) (注:假设时钟周期很短,手还没松开,即键还在按下的状态)2、设置列信号为 1011,行信号也变成(1111)3、设置列信号为 1101,行信号也变成(1111)4、设置列信号为 1110,行信号也变成(0111) ,这时就可以肯定是第一个键 按下。本实验主要完成的实验是完成 44 键盘扫描的,然后获取其键值,并对其进行编码,从而进行按键的识别,并将相应的按键值进行显示。键盘扫描的实现过程如下:对于 44 键盘,通常连接为 4 行、4 列,因此要识别按键,只需要知道是哪一行和哪一列即可,为了完成这一识别过程,我们的思想是,首先固定输出 4 行为高电平,然后输出 4 列为低电平,在读入输出的 4 行的值,通常高电平会被低电4*4 键盘扫描电路设计第 4 页 共 12 页平拉低,如果读入的 4 行均为高电平,那么肯定没有按键按下,否则,如果读入的 4 行有一位为低电平,那么对应的该行肯定有一个按键按下,这样便可以获取到按键的行值。同理,获取列值也是如此,先输出 4 列为高电平,然后在输出 4 行为低电平,再读入列值,如果其中有哪一位为低电平,那么肯定对
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