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orcad电路设计与仿真 OrCAD 的根底学问 OrCAD 常用文档类型*.opj—工程管理文件 *.dsn—电路图文件 *.olb—图形符号库文件 *.lib—仿真模型描述库文件 *.mnl—网络表文件 *.max—电路板文件 *.tch—技术档文件 *.gbt—光绘文件 *.llb—PCB 封装库文件 *.log*.lis—记录说明文件*.tpl—板框文件 *.sf—策略档文件 OrCAD 软件包含的库1、*.olb-Capture 专用的图形符号库 只有电气特性，没有仿真特性的库此类库没有相应的*.lib 库， 且器件属性中没有 PspiceTemplate 属性能够利用 PSpice 进展仿真的库此类库有相应的*.lib 库，且器件 属性中有 PspiceTemplate 属性2、*.lib-PSpice 仿真库，利用 Spice 语言对 Capture 中的图形符号进展 功能定义与描述，可以编辑3、*.llb-PCB Layout 器件封装库OrCAD Layout 供应 3000 多个国际 标准的器件封装 1 培训目标 ：熟识 OrCAD—Capture 设计环境，娴熟驾驭 Capture 的操作方法 及环境参数的设置，最终完全驾驭 Capture。

一、 Capture 设计过程 设置原理图 设计环境新建 Design Project and Schematic 绘制原理图设计后续处理 二、 Capture 操作环境Capture 有三个主要工作窗口： 专案管理视窗：管理与原理图相关的一系列文件，相当于资源管理器 Schematic 窗口：原理图窗口，相当于一张图纸 信息查看窗口〔Session Log〕：用于显示相关操作的提示或出错信息 Schematic 窗口 专案管理视窗 信息查看窗口2三、 Capture 设计参数设置 Capture 的环境参数包括：系统属性及设计模板两大类 系统属性包括(Options>Preferences)： Colors/Print：color settingGrid Display：set grid display mode Pan and Zoom：设置放大与缩小的倍 数Select：select mode settingMiscellaneous：others setting such as Line StyleText Editor：set something about text editor 系统设计模板参数包括(Options>Design Template)： Fonts：set all kinds of fontTitle Block：标题栏内容的设定 Page Size：要绘制的图纸大小Grid Reference：边框的设定与显示 Hierarchy：设置阶层的属性SDT Compatibility：与 SDT 文件兼 容性的设置 四、 新建 Project(create a design project)Capture 的 Project 是用来管理相关文件及属性的。

新建 Project 的同时， Capture 会自动创立相关的文件，如 DSN、OPJ 文件等，依据创立的 Project 类型的不同，生成的文件也不尽一样依据不同后续处理的要求，新建 Project 时必需选择相应的类型Capture 支持四种不同的 Project 类型 3在菜单栏中选择 file>new>Project： Analog or Mixed-signal Circuit 本工程以后将进展数/模混合 仿真PC Board Wizard本工程以后将用来进展印刷 幅员设计Programmable Logic Wizard本工程以后将用于可编程器 件的设计(在 9.2 版本已经不支持) Schematic本工程只进展原理图设计 Name：The name of projectLocation：The save path of project 五、 起先绘制电路图 新建 project 后，进入 Schematic 窗口，那么在窗口右边会出现下 图的工具栏： 放置总线引出管脚放置阶层 放置端口 指示管脚不连接 添加文字 Place junction 放置阶层引脚 Place part Place wire Place Bus Place gnd 绘制无电气性质符号 Place power Place net name 放置分页图纸间的接口 41、 Place part〔放置器件〕在 Capture 中，调用器件特别便利，即使您不清晰器件在库中的名称，也 可以很简单查找并调出访用。

运用 Capture CIS 还可以让您通过 Internet 到 Cadence 的数据库〔包含 1 万多个器件信息〕里查找器件 点击 Place part 快捷按钮或点击 place>part 将调出如下对话框： 要选择的器件 当前运用库 中的器件 添加库到当 前库中 删除当前库 中选中的库 搜寻器件 当前运用的库 实时显示当 前选中器件 的外形 点击 part search…按钮，调出下面的器件搜寻对话框： 搜寻的内容，支 持*号统配符搜寻的结果 搜寻的目标路 径，即只搜寻此 路径下的库文件 中的器件5 2、 连线及放置数据总线(Place wire or bus)点击 Place wire(或 place bus)按钮进入连线〔或放置数据总线〕 状态，此时鼠标变成十字形，移动鼠标，点击左键即可起先连线〔或 放置数据总线〕连线时，在穿插而且连接的地方会有一个红点提示，假如你需 要在穿插的地方添加连接关系，点击 place junction，把鼠标移动到 穿插点并点击左键即可放置数据总线后，点击 place bus entry 按钮放置数据总线引出管 脚，管脚的一端要放在数据总线上。

3、 放置网络名称(place net name)点击 place net alias 按钮，调出 place net alias 对话框，在 alias 对话框中输入要定义的名称，然后点击 OK 退出对话框，把鼠标移 动到你要命名的连线上，点击鼠标左键即可留意：数据总线与数据总线的引出线必须要定义网络名称 4、 放置电源和地(place power or GND)点击 Place power〔或 Place GND〕，调出如下对话框： 图形符号Power 及 GND 的种类 原理图上 power 或 GND 的网络名称 5、 放置阶层及阶层管脚 对于一张大的原理图来说，通常都是把它分割成多个模块，再对子模块进展Capture 支持采纳阶层的方式来设计，即用一个方块 来代替一个功能模块，进入阶层时，Capture 会自动把阶层的管脚关6系引入到阶层原理图里 7点击 Place Hierarchical Block，调出如下对话框： 阶层模块在原理图上的编号 阶层模块的类型： Schematic View VHDL EDIF Project Pspice Model Pspice Stimulus 与 PCB 相关，即是 否当成一个器件 阶层模块包含的原理图名称 阶层模块包含的原理图的文 件名即存储路径 放置好阶层后，接下来就是放置阶层的管脚。

放置阶层管脚时， 必需保证阶层被选中点击 Place Pin，调出下示对话框： 阶层管脚的名字 阶层管脚的类型 对于数字电路，阶层管脚是否 数字总线6、 放置端口与分页图纸间的接口点击 Place Hierarchical Port(或 place Off-page connector)放置端 口(或分页图纸间的接口)，调出如下对话框： 库中的器件图形符号 图纸上的名称8对于端口，不同端口之间的区分在于其类型的不同，它的类型 可以从它的 TYPE 属性中得知，双击端口或选中端口并点击右键在 弹出菜单中选择 Edit Properties，调出如下窗口： 7、 添加文字(place text)点击 place text…按钮，系统弹出如下对话框： 文本内容 假如文本要分行， 请按 Ctrl+Enter 键 更 改文本的 字 体及颜色 六、 原理图绘制后续处理 原理图绘制好之后，接下来就是对电路图进展 DRC 检测，生成网表及材料清单下面，我们将逐一探讨 留意：对原理图进展后续处理，在 Capture 中必需切换到专案管 理窗口下，并且选中*.DSN 文件。

9 101、 DRC 检测(Design Rules Check)点击按钮或(Tools>Design Rules Check)，调出如下设置对 话框： Scope：Check entire design：DRC 检查整个原理图 Check Selection：DRC 只检查你选择的局部 Mode：Use instances(preferred)：运用当前属性〔建议〕 Action：Check design rules：进展 DRC 检测Delete existing DRC marker：删除 DRC 检测标记 Report：DRC 检测的内容Create DRC markers for warnings：在警告的地方放置标记 Check hierarchical port connection：检测阶层端口的连接性Check off-page connector connection：检测分页图纸间接口的连接性 Report identical part references：报告同样的器件序号 Report invalid packaging：报告无效的封装Report hierarchical ports and off-page connection：报告阶层端口和分页图纸间接口的连接 Check unconnected net：检测未连接的网络Check SDT compatibility：检测对于 SDT 文件的兼容性 Report all net name：报告全部网络名称 112、 与 DRC 检测相对应的自动排序功能 通常，一名设计者都须要对自己设计的原理图中的器件编号进 行从新排序。

Capture 供应自动排序功能，允许你对原理图重新排序 点击(或 Tools>Annotate)，调出如下对话框： Scope：Update entire design：更新整个设计 Upda。