微机课件第7章
44页1、第7章 总 线,7.2 总线与总线标准,7.1 32位微处理器的外部引脚,总线是微型计算机中模块到模块之间传输信息的通道,是各种公共信息线的集合,采用总线结构便于部件和设备的扩充。 对微机而言,总线可以分为以下四类:,CPU 片内总线,M,I/O,片间总线,I/O接口板,外部设备,内总线,外总线,片内总线这种总线是微处理器的内总线,在微处理器内用来连接ALU、 CU和寄存器组等逻辑功能单元。这种总线没有具体标准,由 芯片生产厂家自己确定。 片间总线微处理器、存储器芯片、I/O接口芯片等之间的连接总线。片 间总线通常包括数据总线、地址总线和控制总线。 内总线 内总线是微型计算机系统内连接各插件板的总线(系统总线) 内总线有不同的总线标准,如 S-100总线(IEEE-696标), STD总线,IBM-PC总线,ISA总线、EI总线、 SAPCI总线标准等,采用不同总线标准的功能板无法连接在一起。 外总线 用于微型计算机系统之间或者微型计算机与外部设备之间的 通信。外总线技术已经很成熟,各种应用要求皆有标准可遵 循。如并行总线IEEE-488标准,串行总线RS-232标准等。 IEEE13
2、94,USE(通用串行总线)。,7.1 32位微处理器的外部引脚 (教材P.27),1.数据线及控制信号 数据线:D63D0共64位 奇偶校验信号: DP7DP0 ,每个字节产生1个校验位 读校验错: PCHK,Pentium 处理器的外部引脚,2.地址线及控制信号,A31A3:高29位地址线,BE7#BE0#:字节允许信号(存储体选中信号) 外围电路对BE7#BE0#译码以产生A2A0信号,3.系统控制信号,1.时钟输入CLK 2. 可屏蔽中断请求 INTR 3. 非屏蔽中断请求 NMI 4. 系统复位信号 RESET 系统复位后,程序运行的地址为: FFFFFFF0H 实模式 CS: F000H, IP: 0FFF0H,Pentium 处理器的外部引脚,系统时钟,是微处理器内部与外部操作的同步时基信号,由时钟(CLK)输入信号来提供。,CLK,时钟周期: T状态:就是指时钟周期,T,Pentium 处理器的外部引脚,M/IO:=1,表明该总线周期,CPU与存储器交换信息 =0,表明该总线周期,CPU与I/O接口交换信息 W/R: =1,表明该总线周期,CPU进行写操作 =0,表明该
3、总线周期,CPU进行读操作 D/C :=1,表明该总线周期,传输的是数据 =0,表明该总线周期,传输的是指令代码 这三个信号的组合,决定当前总线周期所完成的操作,4.总线周期定义信号(输出) “周期”是一段时间 CPU通过总线与存储器、I/O交换一个数据所需要的时间称为总线周期,Pentium 处理器的外部引脚,8086总线周期,Pentium 处理器的外部引脚,总线周期定义的操作,M/IO D/C W/R 操作 0 0 0 中断 0 0 1 中止/专用周期 0 1 0 I/O读 0 1 1 I/O写 1 0 0 微代码读 1 0 1 保留 1 1 0 存储器读 1 1 1 存储器写,Pentium 处理器的外部引脚,5.总线控制信号(ADS,RDY)与32位微处理器典型时序(教材 P.36) ADS:地址选通信号(输出) 该信号由1 0,表明地址线和总线定义信号(M/IO,W/R,D/C)均为有效可用。,LOCK:总线锁定信号 LOCK=0,通知外围电路,不允许外部信号打断当前的总线周期。当一条指令有.LOCK前缀时,该引脚输出为0。,Pentium 处理器的外部引脚,RDY:准备就
4、绪信号(输入) 该信号由外部电路产生 X86 RDY=0,表明外部电路(存储器、I/O接口)已经做好数据W/R的准备,能在规定时间内完成数据的读写。 RDY=1,表明存储器或I/O不能在规定时间内完成数据的读/写,请CPU延长总线周期。,以下为X86的基本总线周期时序图(以pentium为例),Pentium 处理器的外部引脚,CLK,ADS,BE0BE3,A2A31,M/IO、D/C,W/R,RDY,D0D31,有等待状态总线周期,T1,T2,TW,T1,T2,TW,T1,6.总线仲裁信号 (1)HOLD:总线保持请求(输入) (2)HLDA:总线保持响应(输出),Pentium 处理器的外部引脚,7.2 总线与总线标准,CPU 片内总线,M,I/O,片间总线,I/O接口板,外部设备,内总线,外总线,PC系列微机系统采用开放式的多总线结构,CPU与连接到系统板上的外设打交道须经过芯片级总线、局部总线、(系统总线)和外部总线这样三到四级总线。,总线插槽是主板和 I/O 接口之间的连接器, 为了连接众 多类型的接口电路, 主机一般都配有几 种类型的总线。,PC系列机主板上的总线标准有:
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