微型计算机原理及应用技术 教学课件 ppt 作者 朱金钧 第二章 8086微处理器及其系统

1、8086微处理器及其系统,第 2 章,2.1 8086微处理器简介 2.2 8086系统的存储器组织及I/O组织 2.3 8086系统的工作模式 2.4 8086的操作时序,执行部件（EU） 总线接口部件（BIU）,2.1.1 8086的编程结构,8086微处理器简介,2.1,执行部件,内部寄存器 算术逻辑运算单元(ALU)及标志寄存器 内部控制逻辑电路,内部寄存器,四个通用数据寄存器AX、BX、CX、DX均可用作16位寄存器也可用作8 为寄存器。用作8 位寄存器分别记作：AH、AL、BH、BL、CH、CL、DH、DL。,BX可用作间接寻址的地址寄存器和基地址寄存器， BH、BL可用作8位通用数据寄存器。,有些指令约定以AX(或AL)为源或目的寄存器。,AX(AH,AL)累加器,BX(BH,BL)基址寄存器,通用寄存器, 8086共有8个16位的内部寄存器，分为两组：,通用寄存器 指针和变址寄存器,图2-1 8086CPU内部结构,除用作通用寄存器外，在I/O指令中可用作端口地址寄乘除指令中用作辅助累加器。,CX(CH,CL)计数寄存器,DX(DH,DL)数据寄存器,CX在循环和串操作

2、中操作中充当计数器，指令执行后CX内容自动修改。,指针和变址寄存器, BP( Basic Pointer Register)基址指针寄存器 SP(Stack Pointer Register)堆栈指针寄存器 SI(Source Index Register)源变址寄存器 DI(Destination Index Register)目的变址寄存器,算术逻辑单元(ALU)及标志寄存器,标志寄存器（Flag Register）共有16位，其中7位未用。标志寄存器内容如图：,1.条件标志 -共6位，用于寄存程序运行的状态信息，这些标志往往用作后续指令判断的依据。 2.控制标志 -共3位，用于控制机器或程序的某些运行过程。,8,7 6 5 4 3 2 1,0,15 14 13 12 11 10 9,条件标志, CF(Carry Flag)进位标志 -反映在运算结果的最高位有无进位或借位。 PF(Parity Flag)奇偶标志 -反映运算结果中“1”的个数的奇偶性，主要用于判断数据 传送过程中是否出错。 AF(Auxiliary Flag)辅助进位标志 -加减运算时，若D3向D4产生了进位或借位

3、则AF=1。否则 AF=0。在BCD码运算时，该标志用于十进制调整。,-反映计算结果是否为0。若结果为零则ZF=1，否则ZF=0。 SF(Sign Flag)符号标志 -反映计算结果最高位即符号位的状态。如果运算结果的最高位为1则SF=1（对带符号数即为负数），否则SF=0（对带符号数即为正数）。 OF(Overflow Flag)溢出标志 -反映运算结果是否超出了带符号数的表数范围。,ZF(Zero Flag)零标志,控制标志,共3位，用于控制机器或程序的某些运行过程。, DF(Direction Flag)方向标志 - 用于串处理指令中控制串处理的方向。 IF(Interrupt Flag)中断允许标志 - 用于控制CPU是否允许相应可屏蔽中断请求。 TF(trap flag)陷阱标志 - 用于单步操作。,内部控制逻辑电路,5.总线控制逻辑 - 是CPU外部三总线（AB、DB、CB）的控制电路，它控制CPU与其他部件交换数据、地址、状态及控制信息。,4. 指令队列缓冲器 - 是一个与CPU速度相匹配的高速缓冲寄存器。,3. 指令指针寄存器(IP) - 又称程序计数器，是16位寄存器

4、。,2.地址加法器 - 用于产生20 位物理地址。,1.段地址寄存器(CS、DS、SS、ES) - 用于存放段地址的寄存器称为段寄存器，根据其主要用途，计有代码段寄存器CS、数据段寄存器DS、堆栈段寄器SS、附加段寄存器ES。,总线接口部件,当8086指令队列中有2字节空闲时，总线接口部件就自动将指令从内存中预取到指令队列缓冲器中。 每当EU部件要执行一条指令时，它就从指令队列头部取出指令，后续指令自动向前推进。EU要花几个时钟周期执行指令，指令执行中若需要访问内存或I/O设备，EU就向BIU申请总线周期，若BIU总线空闲，则立即响应，若BIU正在取一条指令，则待取指令操作完成后再响应EU的总线请求。 当指令队列已满，EU又没有申请总线时，则总线空闲。 遇到转移、调用及返回指令时，原先预取到指令队列中的指令已不再有用，BIU就自动清除指令队列中已有内容，从转移、调用或返回的新地址开始，重新从内存中预读取指令并填充指令队列。,总线接口部件和执行部件的管理,8086的引脚及其功能, 8086总线周期 8086的引脚及功能,2.1.2,8086总线周期,8086总线周期,图 2-3 典型的8

5、086总线周期时序,- CPU向多路复用总线上发送地址信息，指出要寻址的内存单元地址或I/O端口地址。 T2状态 ： - CPU从总线上撤消地址，使总线低16位呈现高阻状态，为数据传输作准备。 T3状态 ： - 总线低16位上出现CPU要写出的数据或准备读入的数据。 T4状态 ： - 总线周期结束，若为总线读周期则在T4前沿将数据读入CPU。,T1状态,：,1. GND(地)和Vcc电源。Vcc引脚接+5V电源， GND引脚接地。 2. AD15AD0(Address Data Bus)地址/数据复用引脚，双向、三态。 3. A19/S6A16/S3(Address/Status)地址/状态复用引脚，输出、三态。 4. BHE/S7(Bus High Enable/Status)高8位数据线允许/状态复用引脚，输出、三态。,8086CPU的引脚及功能,在最小模式和最大模式下的通用引脚：,表2-1 S3、 S4代码组合的意义,表2-2 BHE 与 A0 信号的意义,INTR(Interrupt Request)可屏蔽中断请求引脚，输入、高电平有效。 RD(Read)读信号，输出、三态、低

6、电平有效。 CLK(Clock)时钟输入引脚。 RESET(Reset)复位引脚，输入、高电平有效。 READY(Ready)准备好引脚，输入、高电平有效。 11. TEST(Test)测试引脚，输入、低电平有效。 12. MN/MX(Minimum/Maximum Mode Control) 最小/最大模式控制引脚，输入。,5.,NMI(Non-Maskable Interrupt),非屏蔽中断请求引脚，输入。,8086系统的存储器组织及I/O组织,2.2.1 8086系统的存储器组织, 8086存储器的结构 8086系统存储器的地址 8086系统内存地址的一些专用区域,2.2,图2-5 存储体地址空间分配 图2-6 存储体与总线的连接,图2-5 存储体地址空间分配 图2-6 存储体与总线的连接,2-7 a,从偶地址读写一个字节（BHE A0=10) AD15AD8上的数据被忽略，字节内容通过AD7AD0传送。,a) 从偶地址读一个字节,2-7 b,从偶地址读写一个字（BHE A0=00)。 在AD15AD8 、AD7AD0上传送的数据有效。,b) 从偶地址读一个字,从奇地址读写一个

7、字节（BHE A0=01)。 在AD15AD8上传送的数据有效，AD7AD0上数据被忽略。 以上三种读写操作都是在一个总线周期中完成的。,2-7 c,被读的字节,忽略的字节,X,Y,X,存储器,8086CPU,10050H,10051H,c) 从奇地址读一个字节,2-7 d,从奇地址读写一个字。这种操作要占用两个总线周期。,d) 从奇地址读一个字,8086系统存储器的地址,CS=2000H IP=1000H 物理地址=21000H CS=2100H IP=0000H 物理地址=21000H,物理地址的计算公式： 物理地址 = 段地址 16 + 偏移地址 段地址的引入，为程序在内存中浮动创造了条件，一般用户程序只涉及偏移地址。 同一物理地址可以由不同的段地址和偏移地址表示。,例如:,8086系统内存地址的一些专用区域, 0000003FFH 1KB 空间用于存放中断向量表，可存放256个中断服务程序的入口地址，每个地址占4字节。 B0000B0FFFH 4KB 为单色显示器显示缓冲区 ，存放屏幕当前显示字符的ASCII码。 B8000BBFFFH 16KB 为彩色显示器显示缓冲区，存放屏

8、幕当前像素代码。 FFFF0H 启动地址。一般用来存放一条无条件转移指令，转到系统初始化程序。,8086系统的工作模式,2.3.1 最小模式和最大模式的概念,最小模式 最大模式,为了适应各种场合的要求，8086/8088CPU在设计中提供了两种工作模式，即最小模式和最大模式。实际机器中究竟工作在哪一种模式， 根据需要由硬件连接决定。,2.3,8086系统的I/O组织, 8086系统有专用的输入（IN）、输入（OUT）令，用于外设端口（即外设接口中的内部寄存器）的寻址。,2.2.2,最小模式,最大模式：,如果系统中包括两个以上处理器，其一个为8086/8088作为主处理器，其它处理器作为协处理器，这样的系统称为最大模式系统。,：,如果系统中只有一个微处理器8086（或8088），所有总线控制信号都由它产生，则系统中总线控制逻辑信号可先减少到最小，因此这种系统称为最小模式系统。,最小模式系统,当系统只有一个微处理器8086时，将MN/MX引脚接向+5V,构成最小模式系统，其原理如图2-8,1.最小模式系统典型配置 2.8284时钟发生器与8086的连接 如图2-9 3.地址锁存器8282与

9、8086的连接 如图2-10 4.总线驱动器8286与8086的连接 如图2-11,2.3.2,图2-8 8086 单CPU模式（最小模式）系统,图2-9 8284与8086的连接图,图2-10 8282锁存器与8086的连接,图2-11 8286缓冲器与8086的连接,其他控制信号,（1） M/IO(Memory/Input & Output)及WR信号，输出、三态。这两个信号与RD信号合起来决定系统中数据传出的方向，其组合及对应功能见表2-4,5.,表2-4 M/IO、 RD 及WR信号的功能,（3） HLDA(Hold Acknowledge) 总线请求响应信号，输出、高电平有效。 （4）INTA(Interrupt Acknowledge) 中断响应信号，输出、三态、低电平有效。 （5）ALE(Address Latch Enable) 地址锁存允许信号，输出、高电平有效。 （6）DEN(Data Enable) 数据允许信号，输出、三态、低电平有效。 （7）DT/R(Data Transmit/Recieve) 数据收发控制信号，输出、三态。,HOLD(Hold Request),（2）,总线保持请求信号，输入、高电平有效。,最大模式系统,将MN/MX引脚接地就构成了8086CPU的最大工作模式。,最大模式下的有关引脚信号 8288总线控制器 最大模式下系统的典型配置,2.3.3,最大模式下的有关引脚信号,QS0,QS1(Instruction Queue Status)指令队列状态信号，输出。,表2-5 QS1、QS0代

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