总线时序.
25页1、1,5.5 总线时序,时序(Timing)描述各信号随时间的变化及相互间的因果关系。 总线时序描述CPU引脚如何实现总线操作 CPU时序决定系统各部件间的同步和定时,什么是总线操作?,2,5.5.1 基本的总线操作,总线操作是指CPU通过总线对外进行的各种操作 8086的总线操作主要有: 存储器及I/O的读操作 存储器及I/O的写操作 中断响应操作 总线请求及响应操作 总线空闲指CPU正进行内部操作、不进行对外操作的总线空闲状态Ti,什么是总线周期?,3,8086的总线时序(续),任何指令的取指都会产生存储器读总线周期,读取的内容是指令代码 任何一条以存储单元为源操作数的指令都将引起存储器读总线周期,任何一条以存储单元为目的操作数的指令都将引起存储器写总线周期 执行IN指令产生I/O读总线周期,执行OUT指令产生I/O写总线周期 CPU响应可屏蔽中断时产生中断响应总线周期 指令 add bx, ax 将产生那些总线周期?,如何实现同步?,4,8088的总线时序(续),总线操作中的时序同步 CPU总线周期采用同步时序: 各部件都以系统时钟信号为基准 当相互不能配合时,快速部件(CPU)插
2、入等待状态等待慢速部件(I/O和存储器) CPU与外设接口常采用异步时序,它们通过应答联络信号实现同步操作,5,最小组态的总线时序,本节展开微处理器最基本的 4 种总线周期 存储器读总线周期 存储器写总线周期 I/O读总线周期 I/O写总线周期,6,存储器写总线周期 P194,T4,T3,T2,T1,ALE,CLK,A19/S6A16/S3,AD15AD0,A7A0,输出数据,A19A16,S6S3,READY,(高电平),M /IO,WR,7,存储器写总线周期,T1状态输出20位存储器地址A19 A0 , IO/-M输出低电平,表示存储器操作;ALE输出正脉冲,表示复用总线输出地址 T2状态输出控制信号-WR和数据D7D0 T3和Tw状态检测数据传送是否能够完成 T4状态完成数据传送,8,8088 I/O写总线周期,T4,T3,T2,T1,ALE,CLK,A19/S6A16/S3,A15A8,AD7AD0,A15A8,A7A0,输出数据,0000,S6S3,READY,(高电平),IO/M,WR,9,8088 I/O写总线周期,T1状态输出16位I/O地址A15A0,IO/-M输出高
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