全加器数据选择器译码器课件分析
67页1、实验目的 1、熟悉组合逻辑电路的设计方法。 2、掌握基本门电路在组合逻辑电路中的作用。,全加器,一、要求: 设计一个全加器,能进行加数、被加数、低位来的进位信号三者相加,并根据求和结果分别显示本位和及向高位进位的信号。 二、步骤: 1、根据功能要求列出真值表; 2、由真值表写出逻辑表达式; 3、简化和变换逻辑表达式; 4、逻辑图以电路简单、所用器件少为目标; 5、按逻辑图实现实物; 6、进行功能测试,将结果与原理对照,验证其正确性; 7、对设计实验进行总结。,全加器的设计,全加器逻辑功能表,全加器逻辑功能表,全加器原理图,Ai Si Bi Ci Ci+1,74LS08与非门,74LS32或门,74LS86异或门,2输入门电路 引脚图,VCC 4B 4A 4Y 3B 3A 3Y 14 13 12 11 10 9 8 D 1 2 3 4 5 6 7 1A 1B 1Y 2A 2B 2Y GND,能独立写出严谨的、有理论分析的、实事求是的、文理通顺的、字迹端正的实验报告。,数据选择器和译码器,实验目的: 1、掌握数据选择器、译码器的逻辑功能及使用方法。 2、学习用数据选择器、译码器构成组合逻辑
2、电路的方法。,数据选择器 74LS151逻辑图,A0 A1 A2,D0D7是数据输入端; Y和Y输出端; ST是使能端; A2A1A0地址控制端。 ST=0时,器件数选。地址码A2A1A0的状态决定D0D7中某一个通道的数据输送到输出端Y。 ST=1时,Y=0,Y=1。,选择器 74LS151 功能表,1、测试数据选择器74LS151的逻辑功能 地址端A2A1A0,数据端D0D7,使能端 接逻辑开关,输出端Y接逻辑电平显示,按74LS151功能表逐项进行测试,记录测试结果。,数据选择器 74LS151 引脚图,VCC D4 D5 D6 D7 A0 A1 A2 16 15 14 13 12 11 10 9 D 1 2 3 4 5 6 7 8 D3 D2 D1 D0 Y Y ST GND,用8选1数据选择器74LS151实现逻辑函数: 要求:写出设计过程;画出接线图;验证逻辑功能。,A0 A1 A2,D0 D1 D2 D3 D4 D5 D6 D7,VCC,逻辑开关,LED 电 平 显 示,A0 A1 A2,译码器 74LS138 逻辑图,A0 A1 A2,Y0Y7译码输出端,A0A1A2地
3、址控制输入端,STA、STB、STC是使能端。 STA=1、STC+STB=0时,器件译码。由地址输入端A0A1A2状态控制的输出端输出0,其他输出端为1。 STA=0、STC+STB=X或STA=X、STC+STB=1时,所有输出同时为1。,译码器 74LS138功能表,2、测试译码器74LS138的逻辑功能 地址端A2A1A0,使能端 、 、 接逻辑开关,输出端Y0Y7,接逻辑电平显示,按74LS138功能表逐项进行测试,记录测试结果。,译码器 74LS138 引脚图,VCC Y0 Y1 Y2 Y3 Y4 Y5 Y6 16 15 14 13 12 11 10 9 D 1 2 3 4 5 6 7 8 A0 A1 A2 STB STC STA Y7 GND,3、数据选择器和译码器的应用 用数据选择器和译码器组成一个信号传输电路,D0D7为信号输入端,Y0 Y7为信号输出端。 要求:数据选择器和译码器同步工作,即信号从D0输入就必须从Y0输出、信号从D1输入就必须从Y1输出。而且输入为1输出也必须为1、输入为0输出也必须为0。 按要求画出实验电路图。分析电路的工作原理。接好电路,测试电路
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