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《数电考试重点》ppt课件

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  • 卖家[上传人]:tia****nde
  • 文档编号:69673885
  • 上传时间:2019-01-14
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    • 1、数电课程回顾,考试题型: 选择题(20分,10题) 填空题(20分,10空) 组合逻辑电路设计(12分,1题) 类似:4.2.9/P195 组合逻辑电路分析(12分,1题) 类似:4.1.3/P192 同步时序电路分析(18分,1题) 类似:6.2.3/P321 异步时序电路分析(18分,1题) 类似:6.4.2/P325,Chapter1 数字逻辑概论,2、 数制与码制,1、 数字电路的基本概念,2.二进制编码:掌握8421BCD码,3、逻辑代数基础,(1)基本逻辑运算、逻辑门的电路符号,(2)逻辑函数的表示方法: 逻辑函数表达式、真值表、逻辑电路图、卡诺图,4、 正负逻辑变换:了解,Chapter3 逻辑门电路,逻辑代数的两种化简方法: 代数化简法和卡诺图化简法,知道三种基本的运算,各种常用运算符号和表达式。,逻辑代数的基本规则:代入规则,对偶规则。反演规则,Chapter2 逻辑代数,CMOS电路和TTL电路最大的优点是什么?,多余输入端的处理问题:,Chapter4 组合逻辑电路,1.组合逻辑电路的分析,2.组合逻辑电路的设计,3.编码器、译码器、数据分配器、数据选择器、加法器

      2、等,这些芯片如何工作的,使能端如何连接,具体是如何实现逻辑函数的。,4.组合逻辑电路的竞争冒险,Chapter5 触发器,1.基本RS触发器,与非门实现的,RS00不允许,RS11保持, 其余的状态与R相同,或非门实现的,RS11不允许,RS00保持, 其余的状态与S相同,2.同步RS触发器存在空翻现象,RS11不允许,RS00保持,其余的状态与S相同,3.主从触发器存在一次变化现象,4.边沿触发器,5.各种触发器之间的相互转换 掌握各自的特性方程,D触发器,JK触发器,T触发器,T触发器,Chapter6 时序逻辑电路,1. 时序逻辑电路的分析步骤: 逻辑图时钟方程(异步)、驱动方程、输出方程 状态方程状态转换真值表状态转换图和时序 图逻辑功能。,2. 时序逻辑电路的设计步骤: 设计要求最简状态表编码表次态卡诺图 驱动方程、输出方程逻辑图。,3. 计数器会分析给定计数的进制数 会应用常见的集成计数器74161等,4. 移位寄存器会分析判断是左移还是右移,Chapter7 半导体存储器,1.半导体存储器可分为RAM和ROM两大类,RAM: SRAM和DRAM,ROM:只读ROM、 PR

      3、OM、 EPROM、E2 PROM、 快闪存储器等,具有掉电易失性,需定时刷新(或再生),具有非易失性,2.存储器的容量的计算:,3.存储器的容量的扩展,4.ROM点阵图的画法,存储容量(M)字数位数,地址,片数,和容量,Chapter8 脉冲波形的产生和整形,重点掌握555定时器及其应用,多谐振荡器:2个暂稳态,无稳态 单稳态触发器: 1个暂稳态,1个稳态 双稳态触发器: 无暂稳态,2个稳态 施密特触发器:电平触发,有两个不同的阀值电压, 2个稳态,无暂稳态,回求回差电压,(填空、选择),Chapter9 数/模与模/数转换,3.分辨率的计算,1.D/A转换后的模拟量的输出 掌握倒T型电阻网络DAC的计算,2.A/D转换的一般过程:,取样、保持、量化和编码,取样定理,不同的A/D转换方式具有各自的特点,并行A/D转换器速度高;双积分A/D转换器精度高;逐次比较型A/D转换器在一定程度上兼有以上两种转换器的优点,因此得到普遍应用。,2011年模拟题,一、单项选择,1、,某电路的真值表如下表所示,则该电路的逻辑表达式为( )。,(A),(B),(C),(D),1,1,1,1,1,若用触发

      4、器组成某十一进制加法计数器,需要 个触发器,有 个无效状态。,二、填空题,在三个输入信号中,I0的优先权最高,I1次之,I2最低,、它们的输出分别为,L0、L1、L2,要求同一时间内只有一个信号输出。如有两个及两个以上的信号同时输入时,则只有优先权最高的有输出,试设计一个能实现此要求的逻辑电路,三、组合逻辑电路设计题,三、组合逻辑电路设计题,(1)列真值表:,对于输入,设有信号为逻辑“1”;没信号为逻辑“0”。 对于输出,设允许通过为逻辑“1”;不允许通过为逻辑“0”。,(2)由真值表写出各输出的逻辑表达式,四、时序逻辑电路的分析,分析下面的时序逻辑电路(如图所示)。 (1)给出该电路的状态方程、输出方程、驱动方程; (2)给出该电路的状态转换图; (3)指出该电路的逻辑功能。,解:(1)该电路的驱动方程、状态方程、输出方程如下,驱动方程:,状态方程:,输出方程:,(2)该电路的状态转换图:,(3)该电路的逻辑功能是同步4进制加(A=0)/减(A=1)计数器。,状态图,五、时序逻辑电路的设计,用JK触发器及逻辑门电路设计一个3位二进制同步加法计数器。写出设计过程并画逻辑图。,五、时序逻辑电路的设计,解:,(1)状态转换图,(2)根据转换图得到状态转换表,五、时序逻辑电路的设计,(3)根据状态转换表得到次态方程:,(4)由此得驱动方程:,(5)画出逻辑电路图:,六、组合逻辑电路的分析,(1)该电路是同步时序电路。,(2)列出电路的驱动方程组和状态方程组:,七、时序逻辑电路的分析,0,0,0,0,0,1,0,1,0,0,1,1,1,0,0,1,0,1,1,1,0,1,1,1,0,1,0,1,0,1,0,1,0,1,0,1,1,0,1,0,(3)电路是七进制计数器,不能自启动。,

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